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Estudo numérico de acopladores asimétricos aplicados na implementação de portas lógicas totalmente ópticas / Numerical study of asymmetric couplers applied in the implementation of logical gates totally optical

ALMEIDA, J. S. Estudo numérico de acopladores asimétricos aplicados na implementação de portas lógicas totalmente ópticas. 2006. 68 f. Dissertação (Mestrado em Engenharia de Teleinformática) – Centro de Tecnologia, Universidade Federal do Ceará, Fortaleza, 2006. / Submitted by Marlene Sousa (mmarlene@ufc.br) on 2016-04-04T17:14:40Z
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Previous issue date: 2006-12-09 / In this work, we presented an investigation numerical of the transmission and switching fundamental solitons in nonlinear double couplers, constituted for fibers optics with index decreasing dispersion (DDF). Logic Gates Optical are proposed, based in the use of a asymmetric nonlinear directional double coupler (NLDC) of fiber optic and with one of the guides operating with profile of decreasing dispersion. For such end, we obtained the transmission characteristics and, therefore after, made an analyze of the Extinction Ratio and compression factor. We investigated the acting of the coupler proposed operating in the regime solitonic, using ultra-short pulses with 2 ps of width. With the model proposed for the device, got to implement logic gatesAND, OR, XOR and NOT for several phases. / Nesta pesquisa, apresentamos uma investigação numérica da transmissão e do chaveamento de sólitons fundamentais em acopladores duplos não-lineares, constituídos por fibras ópticas com índice de dispersão decrescente (DDF). São propostas portas lógicas ópticas baseadas na utilização de um acoplador direcional não linear (NLDC) duplo assimétrico de fibra óptica e com um dos guias operando com um perfil de dispersão decrescente. Obtivemos as características de transmissão e, logo após, fizemos uma análise do coeficiente de extinção e do fator de compressão. Investigamos o desempenho do acoplador proposto operando no regime solitônico, utilizando pulsos ultra-curtos com 2 ps de largura. Com o modelo proposto para o dispositivo, conseguimos implementar portas lógicas AND, OR, XOR e NOT para diversas fases.

Identiferoai:union.ndltd.org:IBICT/oai:www.repositorio.ufc.br:riufc/16096
Date09 December 2006
CreatorsAlmeida, José Silva de
ContributorsSombra, Antônio Sérgio Bezerra
Source SetsIBICT Brazilian ETDs
LanguagePortuguese
Detected LanguagePortuguese
Typeinfo:eu-repo/semantics/publishedVersion, info:eu-repo/semantics/masterThesis
Sourcereponame:Repositório Institucional da UFC, instname:Universidade Federal do Ceará, instacron:UFC
Rightsinfo:eu-repo/semantics/openAccess

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