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Integrating MDG variable ordering in a VHDL-MDG design verification system

Thèse numérisée par la Direction des bibliothèques de l'Université de Montréal.

Identiferoai:union.ndltd.org:umontreal.ca/oai:papyrus.bib.umontreal.ca:1866/30809
Date January 2001
CreatorsFeng, Yi
ContributorsCerny, Eduard
Source SetsUniversité de Montréal
LanguageEnglish
Detected LanguageFrench
Typeother, autre
Formatapplication/pdf

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