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A logic built-in self-test architecture that reuses manufacturing compressed scan test patterns

Made available in DSpace on 2014-06-12T15:52:41Z (GMT). No. of bitstreams: 1
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Previous issue date: 2009 / A busca por novas funcionalidades no que diz respeito a melhoria da
confiabilidade dos sistemas eletrônicos e também a necessidade de gerir
o tempo gasto durante o teste faz do mecanismo Built-in-Self-Test (BIST)
um característica promissora a ser integrada no fluxo atual de
desenvolvimento de Circuitos Integrados (IC). Existem vários tipos de
BIST: Memories BIST, Logical BIST (LBIST) e também alguns
mecanismos usados para teste as partes analógicas do circuito. O LBIST
tradicional usa um hardware on-chip para gerar todos os padrões de teste
com um gerador pseudo aleatório (PRPG) e analisa a assinatura de saída
gerada por um registrador de assinatura de múltipla entradas (MISR).
Essa abordagem requer a inserção de pontos de teste extras or
armazenagem de informação fora do chip que tornará possível alcançar
uma cobertura de teste > 98%. Também a geração de todos os estímulos
de teste implica no sacrifício no tempo aplicação do teste, o qual pode ser
aceitável para pequenos sistemas executarem auto-teste durante a
inicialização do sistema mas pode tornasse um aspecto negativo quando
testando System-on-chip (SOC) ICs. O fluxo corrente de desenvolvimento
de um IC insere scan chains e gera automaticamente padrões de teste de
scan para alcançar uma alta cobertura para o teste de manufatura.
Técnicas de compressão de dados provaram ser muito úteis para reduzir
o custo de teste enquanto reduzem o volume de dados e o tempo de
aplicação dos testes. Esse trabalho propõe o reuso de padrões de teste
comprimidos usados durante o teste de manufatura para implementar um
LBIST com objetivo de testar o circuito quando ele já está em campo. O
mecanismo LBIST proposto objetiva descobrir defeitos que podem ocorrer
devido ao desgasto do circuito. Uma arquitetura e um fluxo de
desenvolvimento semi-automático do mecanísmo LBIST baseado em
padrões de teste de scan são propostos e validados usando um SoC real
como caso de teste

Identiferoai:union.ndltd.org:IBICT/oai:repositorio.ufpe.br:123456789/1831
Date31 January 2009
CreatorsJosé Costa Alves, Diogo
ContributorsNatividade da Silva Barros, Edna
PublisherUniversidade Federal de Pernambuco
Source SetsIBICT Brazilian ETDs
LanguageEnglish
Detected LanguagePortuguese
Typeinfo:eu-repo/semantics/publishedVersion, info:eu-repo/semantics/masterThesis
Sourcereponame:Repositório Institucional da UFPE, instname:Universidade Federal de Pernambuco, instacron:UFPE
Rightsinfo:eu-repo/semantics/openAccess

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