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Realisierung eines Verilog/VHDL Codegenerators für graphisch erfasste Finite State Machines

Chemnitz-Zwickau, Techn. Univ., Diplomarb., 1996.

Identiferoai:union.ndltd.org:OCLC/oai:xtcat.oclc.org:OCLCNo/314373759
Date January 1997
CreatorsRoy, Diana.
Publisher[S.l. : s.n.],
Source SetsOCLC
LanguageGerman
Detected LanguageGerman
TypeOnline-Publikation.

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