Orientador : Prof. Dr. Eduardo Todt / Dissertação (mestrado) - Universidade Federal do Paraná, Setor de Ciências Exatas, Programa de Pós-Graduação em Informática. Defesa: Curitiba, 16/09/2014 / Inclui referências / Resumo: Os algoritmos de detecção de bordas necessitam de um poder muito alto de
processamento, devido 'a quantidade de convoluções, problema agravado no caso de
aplicações que exigem processamento de video em tempo real, como em rob'otica m'ovel.
Uma maneira de melhorar o desempenho 'e implementar o algoritmo diretamente em
hardware. Esta dissertação descreve um projeto de uma implementação do algoritmo de
detecção de bordas Canny, realizada com a linguagem de descrição VHDL e com a
linguagem de programação C++, em uma plataforma híbrida. A suavização, o cálculo
do gradiente, a supressão de não máximos e o threshold duplo estão implementados em
um computador de mesa do tipo PC (Personal Computer ) e a segunda etapa da
histerese est'a implementada em um FPGA (Field Programmable Gate Array), modelo
Virtex 6, da Xilinx.
A arquitetura da parte implementada no FPGA 'e em pipeline e paralela.
Palavras-chave: Canny; FPGA; Hardware Reconfigur'avel; VHDL; Processamento de
Imagens; Detec¸c˜ao de Bordas; Arquitetura Paralela; Arquitetura H'ýbrida; pipeline. / Abstract: The edge detection algorithms require a very high power processing due the number of
convolutions, an issue in real-time video applications like mobile robotics. One way to
improve performance is to implement the algorithm directly in hardware. This paper
describes and demonstrates the results of an implementation of the edge detection Canny
algorithm performed with VHDL and the C++ programming language in a hybrid
platform i.e.; Noise reduction, gradient intensity finding, non-maxima supression and
double thresholding are implemented on a Desktop Personal Computer and the second
part of hysteresis is implemented in a Xilinx Virtex 6 FPGA (Field Programmable Gate
Array). The architecture designed on FPGA is a pipeline and parallel type.
Keywords: Canny; FPGA; Reconfigurable Hardware; VHDL; Image Processing; Edge
Detection; Parallel Architecture; Hybrid architecture; pipeline.
| Identifer | oai:union.ndltd.org:IBICT/oai:dspace.c3sl.ufpr.br:1884/36966 |
| Date | January 2014 |
| Creators | Vidal, Leonardo de Amaral |
| Contributors | Todt, Eduardo, Universidade Federal do Paraná. Setor de Ciências Exatas. Programa de Pós-Graduação em Informática |
| Source Sets | IBICT Brazilian ETDs |
| Language | Portuguese |
| Detected Language | Portuguese |
| Type | info:eu-repo/semantics/publishedVersion, info:eu-repo/semantics/masterThesis |
| Format | 146f. : il., tabs., application/pdf |
| Source | reponame:Repositório Institucional da UFPR, instname:Universidade Federal do Paraná, instacron:UFPR |
| Rights | info:eu-repo/semantics/openAccess |
| Relation | Disponível em formato digital |
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