[pt] O objetivo desta dissertação consiste no desenvolvimento e
na realização de um analisador de redes e elementos de
redes na taxa de 1 Gbps. A tecnologia de lógica programável
(FPGA) é utilizada através de uma placa de desenvolvimento
ativada por ferramentas computacionais dedicadas a esta
aplicação. O módulo realizado é utilizado para caracterizar
uma rede e alguns elementos de rede em função da taxa
máxima de transmissão de pacotes, número de pacotes
perdidos e retardo. Uma comparação entre os resultados
fornecidos pelo módulo desenvolvido e um equipamento
comercial é apresentada e comentada. Finalmente, as
principais vantagens da proposta desta dissertação são
destacadas. / [en] The main purpose of this dissertation is the development
and realization of a Gigabit Ethernet network element
analyzer. The FPGA technology is employed through a
development board, activated by dedicated software tools.
The prototype realized is employed to describe a network
and network elements by maximum transmission capacity,
frame loss and delay. A comparative analysis
between this prototype and a commercial equipment is
performed. Finally, the main advantages of this
dissertation will be highlighted.
| Identifer | oai:union.ndltd.org:puc-rio.br/oai:MAXWELL.puc-rio.br:12365 |
| Date | 17 October 2008 |
| Creators | FERNANDO DINIZ HAMMERLI |
| Contributors | MARBEY MANHAES MOSSO |
| Publisher | MAXWELL |
| Source Sets | PUC Rio |
| Language | Portuguese |
| Detected Language | Portuguese |
| Type | TEXTO |
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