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Previous issue date: 2010 / Petróleo Brasileiro S.A. / Neste trabalho são apresentadas a descrição em linguagem VHDL e a implementa
ção em FPGA de um amplificador sensível à fase (lock-in) e de um módulo de comunica
ção CAN para o desenvolvimento de um sensor inteligente inspirado na família de
padrões IEEE 1451. O amplificador sensível à fase é utilizado para detecção e condicionamento
de sinais. Sua implementação em formato digital possibilita a utilização
de técnicas de processamento digital de sinais. A síntese do amplificador utilizou apenas
6% dos recursos lógicos da FPGA escolhida, possibilitando a implementação de
vários amplificadores em paralelo, na mesma FPGA. O módulo CAN implementado
é capaz de se comunicar em rede com outros módulos CAN, disponíveis comercialmente.
A utilização lógica do módulo CAN implementado foi comparada à do módulo
HurriCANe, desenvolvido pela ESA. O funcionamento dos circuitos foi verificado com
êxito a partir de simulações e de testes realizados após a implementação em FPGA. A
interligação do módulo CAN ao amplificador lock-in foi realizada com sucesso, sendo
ocupados apenas 14% dos recursos da FPGA
| Identifer | oai:union.ndltd.org:IBICT/oai:repositorio.ufpe.br:123456789/5015 |
| Date | 31 January 2010 |
| Creators | Edenilson Oliveira Reges, José |
| Contributors | José Pinheiro Santos, Edval |
| Publisher | Universidade Federal de Pernambuco |
| Source Sets | IBICT Brazilian ETDs |
| Language | Portuguese |
| Detected Language | Portuguese |
| Type | info:eu-repo/semantics/publishedVersion, info:eu-repo/semantics/masterThesis |
| Source | reponame:Repositório Institucional da UFPE, instname:Universidade Federal de Pernambuco, instacron:UFPE |
| Rights | info:eu-repo/semantics/openAccess |
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