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Contribution à la répartition d'un système à structure de domaines sur un réseau local de micro-ordinateurs faiblement couplés.Delattre, Éric, January 1900 (has links)
Th. doct.-ing.--Trait. de l'inf.--Lille 1, 1979. N°: 242.
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Fonctions élémentaires algorithmes et implémentations efficaces pour l'arrondi correct en double précision /Defour, David. Muller, Jean-Michel Dinechin, Florent de January 2003 (has links)
Thèse de doctorat : Informatique : Lyon, École normale supérieure (sciences) : 2003. / Bibliogr. p. [125]-129. Index.
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Algorithmique parallèle réseaux d'automates, architectures systoliques, machines SIMD et MIMD /Robert, Yves Robert, François January 2008 (has links)
Reproduction de : Thèse d'Etat : informatique : Grenoble, INPG : 1986. Reproduction de : Thèse d'Etat : informatique : Grenoble 1 : 1986. / Titre provenant de l'écran-titre.
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Une méthodologie multi-critères pour l'évaluation de performance appliquée aux architectures de réseaux d'interconnexion multi-étagesAljundi, Ahmad Chadi Dekeyser, Jean-Luc January 2007 (has links)
Reproduction de : Thèse de doctorat : Informatique : Lille 1 : 2004. / Label européen. N° d'ordre (Lille 1) : 3475. Texte de la thèse en anglais. Synthèse en français. Résumé en français et en anglais. Titre provenant de la page de titre du document numérisé. Bibliogr. p. 109-116.
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ARTO un modèle d'objet adaptable pour la qualité de service /Contreras, José-Lino Sourrouille, Jean-Louis January 2004 (has links)
Thèse doctorat : Informatique. Informatique et Systèmes Coopératifs pour l'Entreprise : INSA LYON : 2002. / Titre provenant de l'écran-titre. Bibliogr. p. 127-130.
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Conception et validation des algorithmes systoliquesBenaini, Abdelhamid Tchuente, Maurice. Plateau, Brigitte. January 2008 (has links)
Reproduction de : Thèse de doctorat : mathématiques appliquées : Grenoble, INPG : 1988. / Titre provenant de l'écran-titre. Bibliogr. p. 153-159.
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Réseaux systoliques pour la résolution de problèmes linéairesMelkemi, Lamine. Tchuente, Maurice. January 2008 (has links)
Reproduction de : Thèse de 3e cycle : mathématiques appliquées : Grenoble 1 : 1986. / Titre provenant de l'écran-titre. Bibliogr. p. 105-109.
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Opérateurs VLSI pour l'intégration d'algorithmes d'intelligence artificielle /Ali-Yahia, Tahar. January 1992 (has links)
Th.--Electronique et communications--Paris--ENST, 1992. / Notes bibliogr.
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Envrionnement [sic] fonctionnel distribué et dynamique pour systèmes embarquésAmar, Abdelkader Dekeyser, Jean-Luc Boulet, Pierre. January 2003 (has links) (PDF)
Thèse doctorat : Informatique : Lille 1 : 2003. / N° d'ordre (Lille 1) : 3393. Résumé en français et en anglais. Bibliogr. p. 129-135.
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Analyse du temps d'exécution pire-cas de tâches temps-réel exécutées sur une architecture multi-cœursBourgade, Roman 22 October 2012 (has links) (PDF)
Les défaillances des applications embarquées dans les systèmes temps-réel strict peuvent avoir des conséquences graves (catastrophes industrielles, mise en danger de vies humaines). La vérification des contraintes temporelles d'un système temps-réel strict dépend de la connaissance du temps d'exécution pire-cas des tâches constituant l'application embarquée. L'utilisation de processeurs multi-cœurs est l'un des moyens actuellement mis en œuvre afin d'améliorer le niveau de performances des systèmes embarqués. Cependant, la détermination du temps d'exécution pire-cas d'une tâche sur ce type d'architecture est rendue difficile par le partage de certaines ressources par les cœurs, et notamment le bus d'interconnexion permettant l'accès à la mémoire centrale. Ce document propose un nouveau mécanisme d'arbitrage de bus à deux niveaux permettant d'améliorer les performances des ensembles de tâches exécutés tout en garantissant le respect des contraintes temporelles. Les méthodes décrites permettent d'établir un niveau de priorité d'accès au bus optimal pour chacune des tâches exécutées. Elles permettent également de trouver une allocation optimale des tâches aux cœurs lorsqu'il y a plus de tâches à exécuter que de cœurs disponibles. Les résultats expérimentaux montrent une diminution significative des estimations de temps d'exécution pire-cas et de l'utilisation du processeur.
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