The NetCOPE framework has proven itself as a viable framework for rapid development of hardware accelerated wire-speed network applications using Network Functions Virtualization (NFV). To meet the current and future requirements of such applications the NetCOPE platform has to catch up with upcoming 400 Gigabit Ethernet. Otherwise, it may become deprecated in following years. Catching up with 400 Gigabit Ethernet brings many challenges bringing necessity of completely different way of thinking. Multiple network packets have to be processed each clock cycle requiring a new concept of processing. Advanced memory management is used to ensure constant memory complexity with respect to the number of DMA channels without any impact on performance. Thanks to that, even more than 256 completely independent DMA channels are feasible with current technology. A lot of effort was made to create the framework as generic as possible allowing deployment of 400 Gigabit Ethernet and beyond. Emphasis is put on communication between the framework and host computer via PCI Express technology. Multiple Ethernet ports are also considered. The proposed system is prepared to be deployed on the family of COMBO cards, used as a reference platform.

Diploma thesis handles with set up of peripheral modules of the processor TC275 families’ AURIX developed by Infineon. Processor’s peripheral module QSPI implements communication SPI set up as master on a bus supported by another processor’s module DMA. Module DMA periodically service transmit and receive shift buffers of QSPI which are connected with slave analog to digital converter IC CIC751. Another peripheral module is MultiCAN. Programmed drivers used only basic header files with register definition of processor TC275, which are part of IDE TriCore Free Entry Tool Chain used for created drivers.

Modulära synthesizers blev en stor kommerciell succé in på 1960-talet som sedan in på 2010-talet skulle få uppmärksamhet på nytt, troligtvis i samband med en "Do it yourself-rörelse" (DIY-movement). En sampler är ett instrument som finns både självständigt och som styrspänningskontrollerad modul inom modulärsyntes. Vanligt är att vissa aspekter till uppspelning går att kontrollera med styrspänning, exempelvis uppspelningshastigheten. Något varken jag eller min handledare har sett tidigare är direktåtkomst med styrspänning till minnespekare i en ljudbuffer för samplermoduler. Därför implementerade jag The Buffer, en samplermodul i en virtuell modulärsyntesmiljö - VCV Rack. I arbetet undersökte jag två frågeställningar: kopplingen mellan inspänningen till modulen och det resulterande ljudet, samt även vilket maximalt minnesområde som går att adressera för styrspänningen så att pekarna sveper konsekutivt genom varje frame av ljudspåret. I den senare utforskade jag två möjliga svar, ett teoretiskt största möjliga, och ett med utgångspunkt i min implementation. Jag utförde även en användarstudie på mer subjektiv basis för en indikation på modulens användbarhet.

General propose processor (GPP) are demanded high performance in dataintensive applications, such as deep learning, high performance computation (HPC), where algorithm kernels like GEMM (general matrix-matrix multiply) and SPMV (sparse matrix-vector multiply) kernels are intensively used. The performance of these data-intensive applications are bounded with memory bandwidth, which is limited by computing & memory access coupling and memory wall effect. Recent works proposed streaming ISA extensions to maximum memory bandwidth, which decouple computation and memory access, prefetching data by memory access pattern, hiding architecture latency. However, the performance of irregular memory access still suffers from low bus utilization when transferring narrow stream elements on wide memory buses. To solve this problem, the project proposes a new on-chip bus protocol - AXI-PACK, extended from Advance eXtensible Interface4 (AXI4) on-chip protocol, which enables high bandwidth end-to-end irregular memory streaming. Next, an on-chip multi-banked SRAM memory system is designed for supporting AXI-PACK, and AXI-PACK is evaluated under an open-source RISC-V vector processor system. AXI-PACK demonstrates high bus utilization and bandwidth in irregular access, which helps speedup GEMM(element size = 32bits) kernel 6.1 times and SpMV(element size = 32bits) kernel 3.0 times under bus data width of 256 bits, comparing to standard AXI4 bus. / General propose processor (GPP) efterfrågas hög prestanda i dataintensiva applikationer, såsom djupinlärning, högpresterande beräkningar (HPC), där algoritmkärnor som GEMM (generell matris-matris multiplicera) och SPMV (sparse matrix-vector multiply) kärnor används intensivt. Prestandan för dessa dataintensiva applikationer är begränsade till minnesbandbredd, som begränsas av dator & minnesåtkomstkoppling och minnesväggeffekt. Nya arbeten föreslog strömning av ISA-förlängningar till maximal minnesbandbredd, som frikopplar beräkning och minnesåtkomst, förhämtning av data genom minnesåtkomstmönster, döljer arkitekturlatens. Emellertid lider prestandan för oregelbunden minnesåtkomst fortfarande av låg bussanvändning vid överföring av smala strömelement på breda minnesbussar. För att lösa detta problem föreslår projektet ett nytt on-chip-bussprotokoll - AXIPACK, utvidgat från Advance eXtensible Interface4 (AXI4) on-chip-protokoll, vilket möjliggör oregelbunden minnesströmning med hög bandbredd ändetill-ände. Därefter är ett SRAM-minnessystem med flera banker på chip designat för att stödja AXI-PACK, och AXI-PACK utvärderas under ett RISC-V vektorprocessorsystem med öppen källkod. AXI-PACK visar hög bussanvändning och bandbredd vid oregelbunden åtkomst, vilket hjälper till att snabba upp GEMM (elementstorlek = 32 bitar) kärnan 6,1 gånger och SpMV (elementstorlek = 32 bitar) kärnan 3,0 gånger under bussdatabredden på 256 bitar, jämfört med standard AXI4-buss .

The focus of this master's thesis is on the topic of instrumentation during the compilation process in the LLVM compiler. The tool enables to instrument memory accesses and functions. The instrumentation is realized through adding a novel pass to the LLVM's optimalization phase. Information about variables are managed by the created framework. The framework is linked with the program. The overhead of the instrumentation increases duration of the program by about 14 % in the case of switched off indirect addressing and 23 % in the case of switched on indirect addressing. The main benefit of the work is the possibility of easy instrumentation of the program which can even monitor operation of local variables through indirect addressing) and support multithread programs. The framework is part of Testos's tools where it provides automatic instrumentation in the Spectra tool.

Modular multilevel converters (MMCs) are the preferred converter solution in flexible ac transmission systems (FACTS) and high-voltage direct current (HVDC) applications. This is due to the high quality of the voltage and current signals, lower overall losses, and fewer problems with switching-related EMI. However, without an efficient and fast data recording system, the sampled data from current and voltage measurement boards can cause long latencies in the control system and make it difficult to analyze the operation of MMCs. In this thesis, a filed programmable gate array (FPGA)-based closed-loop control, and a high-speed data recording system is developed for a low-power singlephase MMC prototype. In the prototype, a data-transmission scheme based on the RS485 (TIA/EIA- 485) standard exists. This protocol offers a robust solution for transmitting data over noisy environments. A direct memory access (DMA) scheme is utilized to transmit sampled data from the programmable logic (PL) to the processing subsystem (PS) in the Zynq-7000 SOC. Moreover, an asymmetric multiprocessing (AMP) mechanism was implemented on the two processor cores in the PS. The first processor controls the power transmission to and from the power grid, and the second processor runs the ethernet application to transmit sampled data to the computer using MATLAB. For the closed-loop control of this MMC prototype, a phase-locked loop (PLL), a proportional resonant (PR) current controller, and an energy control loop for capacitor voltage balancing and control are implemented. The results showed that the output power of this single-phase MMC prototype is under control and each sub-module capacitor voltage is balanced and charged to the desired value. The sampled data can be recorded from the computer through the implemented data recording system at 25.6Mbps. Moreover, a dynamic oscilloscope function is developed in MATLAB using this online data recording scheme. / Modulära multilevel-omvandlare (MMC) är den föredragna omvandlarlösningen i flexibla växelströmstransmissionssystem (FACTS) och applikationer med högspänningslikström (HVDC). Detta beror på den höga kvaliteten på spännings- och strömsignalerna, lägre totala förluster och färre problem med omkopplingsrelaterad EMI. Utan ett effektivt och snabbt dataregistreringssystem kan dock samplade data från ström- och spänningsmätkort orsaka långa latenser i styrsystemet och göra det svårt att analysera driften av MMC:er. I denna avhandling utvecklas en FPGA-baserad styrning med sluten slinga och ett höghastighetsdataregistreringssystem för en lågeffekts enfas MMCprototyp. I prototypen finns ett dataöverföringssystem baserat på standarden RS485 (TIA/EIA-485). Detta protokoll erbjuder en robust lösning för att överföra data över bullriga miljöer. Ett schema för direkt minnesåtkomst (DMA) används för att överföra samplade data från den programmerbara logiken (PL) till bearbetningsundersystemet (PS) i Zynq-7000 SOC. Dessutom implementerades en asymmetrisk multiprocessing (AMP)-mekanism på de två processorkärnorna i PS. Den första processorn styr kraftöverföringen till och från elnätet, och den andra processorn kör ethernetapplikationen för att överföra samplade data till datorn med MATLAB. För styrning med sluten slinga av denna MMC-prototyp implementeras en faslåst slinga (PLL), en proportionell resonansströmkontroller (PR) och en energikontrollslinga för balansering och kontroll av kondensatorspänning. Resultaten visade att uteffekten från denna enfasiga MMC-prototyp är under kontroll och varje undermoduls kondensatorspänning är balanserad och laddad till önskat värde. Samplade data kan spelas in från datorn genom det implementerade dataregistreringssystemet vid 25,6 Mbps. Dessutom utvecklas en dynamisk oscilloskopfunktion i MATLAB med hjälp av detta onlinedataregistreringsschema.