Ce document propose de synthétiser mes activités de recherche selon l'organisation suivante. Le chapitre 1 est consacré à l'intégration d'amplificateurs de puissance silicium sur des technologies CMOS et BiCMOS en présentant les solutions " circuit " que nous avons développé. Cette activité a débuté lors de mes travaux de thèse en octobre 2002 à travers la conception d'amplificateurs de puissance en technologie BiCMOS SiGe reconfigurables multi-standard pour les applications mobiles. Puis, une structure d'amplificateurs de puissance innovante est proposée afin d'intégrer totalement les parties émission et réception sur une seule et même puce CMOS. La notion de signature thermique du PA est introduite. Afin de surmonter le compromis linéarité/rendement inhérent aux amplificateurs de puissance traditionnels, nous retrouvons dans le chapitre 2 différentes architectures qui répondent à l'augmentation du rendement des PAs linéaires et l'augmentation de la linéarité des PAs à haut rendement. L'option choisie est alors de travailler " autour " du PA sur des techniques prometteuses en termes de perspectives d'intégration et de performances. Ainsi, les études de la mise en parallèle de cellules amplificatrices et des amplificateurs Doherty sont décrites. De plus, la technique de linéarisation par boucle cartésienne est développée en y associant de l'intelligence numérique. Le chapitre 3 se distingue des deux premiers dans le sens où il est consacré aux travaux effectués sur les architectures d'émetteur dans lequel nous avons développé un émetteur original aux fréquences RF et millimétriques. Cette architecture, innovante dans sa forme, permet d'émettre directement le signal modulé par un bloc que nous appelons Power VCO. Il s'agit d'un oscillateur contenant un amplificateur de puissance dans la chaine directe et un filtre dans la chaine de retour. Nous proposons pour la chaine directe l'utilisation de PA à haut rendement et pour la chaine de retour de réseaux LC, de résonateurs BAW, de filtres BAW, et de vecteur-modulateur. Le chapitre 4 quant à lui expose mon projet de recherche. Il se nourrit des éléments présentés dans les trois premiers chapitres. Le travail au niveau " circuit " est toujours présent en proposant des études sur de nouvelles classes de fonctionnement, sur des technologies GaN, graphene et FinFET. Le travail " autour du PA " se poursuit avec de nouvelles applications pour la boucle cartésienne et la recherche de solution originale de réduction de la consommation en mêlant des méthodes de traitement du signal. Enfin, la réflexion au niveau système sur la façon de penser les émetteurs est également relancée. En parallèle de ces activités, la dernière partie du document est consacrée aux activités d'enseignement et d'intérêt généraux au niveau de l'établissement d'enseignement (IPB), du laboratoire, des activités nationales et internationales.

Cette thèse porte sur la conception d'un amplificateur de puissance à haut rendement entrant dans une architecture d'émission pour des terminaux mobiles multi-radio fonctionnant dans la bande de fréquences 800MHz - 6 GHz. Une architecture polaire avec codeur d'enveloppe ΣΔ a été validée, pour un fonctionnement multiradio, avec un signal test respectant la norme actuellement la plus contraignante, WiMAX mobile - IEEE 802.16e. Cette validation montre la pertinence, du fait de la nature invariante en amplitude du signal issu de l'architecture, d'avoir recours à un amplificateur à haut rendement en classe commutée. Une topologie novatrice d'amplificateur de puissance (PA) a été développée pour la conception et la fabrication de ce circuit. Le procédé de réalisation du PA en technologie ST CMOS SOI 130 nm est détaillé et les simulations sont validées par une caractérisation complète du PA à l'aide de mesures fréquentielles et temporelles. Mesuré avec un signal sinusoïdal à la fréquence de 3,3 GHz, le PA permet d'obtenir une puissance de sortie de +23 dBm avec un rendement en puissance ajoutée de 61% et un gain en puissance de 14 dB. Conçu et réalisé en technologie compatible CMOS, ce PA permet d'envisager une solution type SoC pour l'ensemble de l'architecture

Au cours des dernières années, la faisabilité des émetteurs-récepteurs millimétriques entièrement intégrés a été largement démontrée en technologies silicium CMOS et BiCMOS. Deux axes sont actuellement très porteurs dans ce domaine : (1) l’amélioration des performances à travers des boucles d’asservissement intégrées (ALC : Automatique Level Control), (2) le développement de solutions de caractérisation sur silicium des composants millimétriques (BIT : Built In Test). L’objectif principal de cette thèse est de développer les blocsde base (détecteurs de puissance et baluns) pour répondre aux besoins actuels des applications ALC et BIT. Les circuits réalisés combinent l’avantage de composants actifs de la technologie BiCMOS 55 nm, de STMicroelectronics, avec l’avantage des structures passives à ondes lentes développées à l’IMEP-LAHC. Ce travail permet un développement plus rapide et robuste pour la future génération de systèmes millimétriques. / In the past few years, the feasibility of high performance millimeter-wave(mmWave) fully-integrated transceivers has been widely demonstrated in both CMOS andBiCMOS silicon technologies. Nowadays, automatic level control (ALC) solutions and in-situtesting (BIT: Built in Testing) and characterization of mmWave components, constitute themajor research interest in mmWave domain. This work focus on the development of the mainbuilding blocks (power detectors and baluns) that meet the requirement of the today’smmWave ALC and BIT applications. The developed prototypes take advantage of the highperformances transistors offered by the BiCMOS 55 nm technology, from STMicroelectronics, aswell as the high performances of the slow-wave based passive components developed by theIMEP-LAHC laboratory. Several prototypes were developed as a proof of concept for thedesignated applications. This work helps future generation millimeter-wave systems to havefaster development and better robustness.

L’évolution des différentes générations de systèmes de télécommunications cellulaires a entraîné une complexité du frontal des terminaux mobiles caractérisés notamment par la multiplication des chaînes RF qui le constituent. Chaque chaîne est dédiée à un standard, ce qui n’est pas optimale ni du point de vue du coût, ni de l’encombrement. Afin d’optimiser les performances et la consommation du transmetteur radiofréquence, l’approche retenue dans cette thèse consiste à concevoir de façon globale différents blocs afin de partager les contraintes. Dans cette thèse, l’approche globale de la co-conception est organisée en deux sous études. Celles-ci sont destinées à terme à être intégrées dans un même frontal RF entièrement configurable.La première étude aborde la problématique de la conception conjointe entre une antenne et un amplificateur de puissance (PA) qui sont traditionnellement conçus séparément. Nous avons tout d’abord déterminé les spécifications de l’antenne permettant de maximiser le transfert d’énergie entre ces deux blocs. Ensuite, nous avons conçu l’antenne en partageant les contraintes d’impédance à la fois dans la bande utile et aux harmoniques entre cette dernière et le PA afin de relâcher les spécifications sur le réseau d’adaptation d’impédance. Cette approche permet de maintenir la linéarité du PA à des niveaux de puissances supérieures par rapport au cas où l’antenne est adaptée sur 50 Ω.La seconde étude s’intéresse à la conception conjointe d’antennes et de composants agiles. Nous avons réparti l’effort de miniaturisation et les pertes ohmiques associées entre la structure d’antenne et le composant agile (capacité commutable numériquement). Les développements présentés se sont appuyés sur des simulations électromagnétiques, des modélisations, des caractérisations système (linéarité et temps de commutation) et des mesures en rayonnement (efficacité) de prototypes d’antennes miniatures dans les bandes basses 4G. Nos études ont abouti à la conception d’une antenne fente reconfigurable fonctionnant sur la bande instantanée maximale autorisée par la 4G. Pour une intégration sur smartphone, l’élément rayonnant n’occupe que 18 x 3 mm2 de surface soit λ_0/30×λ_0/180 à 560 MHz. La fréquence de résonance de l’antenne varie entre 560 MHz et 1.03 GHz et l’efficacité totale varie entre 50% et 4%. Un banc de mesure de la linéarité a été implémenté afin d’évaluer la linéarité des antennes agiles. La spécification de linéarité exigée par le standard est maintenu jusqu’à une puissance de 22 dBm. / The recent development of cellular communication standards has led to an increasing RF front-end complexity due to the ever increasing number of RF needed paths. Each RF path is dedicated to a frequency bands group which might not be optimal for cost and occupied space area. Consequently, in order to optimize the RF performances and energy consumption, the approach used in this thesis is to share the constraints between the PA and the antenna of the front-end: this is called co-design. In this thesis, the considered co-design approach is twofold and in near future both results should be simultaneously considered and integrated into one fully reconfigurable RF front-end design.The first study addresses the co-design of an antenna and its associated power amplifier (PA), which are traditionally designed separately. We first determine the antenna impedance specifications to maximize the tradeoff between the energy transfer and PA linearity. Then, we propose to remove the impedance matching network between antenna and PA, while demonstrating that a low impedance antenna can maintain the RF performances. Contrarily to the classical approach where the antenna is matched to 50 Ω, the proposed co-design shows the possibility to keep the linearity of the PA even for high power levels (> 20 dBm).The second study focuses on the co-design of an antenna and tunable components. We are sharing the miniaturization effort and the resistive losses between the antenna structure and the tunable capacitor (DTC). The achieved developments are based on electromagnetic simulations, modeling, system characterization (linearity and switching time) and radiation measurements (efficiency) of miniature reconfigurable antenna prototypes in the 4G low bands. The considered studies have led to the design of a frequency reconfigurable antenna addressing the maximum instantaneous available bandwidth authorized by 4G. The radiator occupies only 18 x 3 mm2 (λ0/30 x λ0/180 at 560 MHz), and thus it is extremely suitable for a possible integration onto smartphones. The antenna resonance frequency is tuned between 560 MHz and 1030 MHz and the total efficiency varies between 50% and 4%. For the first time, the impact of SOI DTC implemented on the antenna radiating structure on linearity is measured with a dedicated test bench. The linearity specified by 4G is maintained up to 22 dBm of transmitted power.

Cette thèse porte sur l'étude et l'intégration en technologie SOI CMOS d'un circuit amplificateur de puissance multimode multibande (MMPA) reconfigurable capable d'adresser les modes 2G/3G/4G sur plusieurs bandes de fréquences. Les modules MMPA actuels (modules hybrides) reposent sur l'utilisation de plusieurs technologies, en particulier la technologie GaAs en ce qui concerne les chaines d'amplification, et représentent une part importante du coût et de l'encombrement d'une tête d'émission radiofréquences. La solution originale proposée dans cette thèse représente une avancée significative en termes d'intégration par rapport à l'état de l'art et les premiers résultats mesurés démontrent la pertinence de l'architecture proposée. Une étude sur l'optimisation du rendement énergétique au niveau de l'étage de puissance en présence de signaux modulés en amplitude et phase de type 3G et 4G est également proposée. Cette étude adresse les potentialités des techniques de modulation de la charge et de l'alimentation et permet de comparer les deux approches.Après une présentation du contexte et de l'état de l'art, une méthodologie de conception originale reposant sur l'étude de différentes classes de fonctionnement est proposée. Cette méthodologie permet en particulier de pré-dimensionner les cellules de puissance reconfigurables ainsi que leurs impédances de source et de charge en fonction des contraintes de puissance et de linéarité dans les différents modes pour avoir le meilleur rendement. Elle permet aussi de choisir les topologies de réseaux d'adaptation accordables pertinentes.Ces études ont conduit à la réalisation de deux démonstrateurs intégrés en technologies SOI CMOS 130 nm. Le premier prototype est un amplificateur multimode et multibande reconfigurable à deux étages capable de fonctionner en mode saturé et en mode linéaire pour des bandes de fréquence situées entre 700MHz et 900MHz. L'architecture proposée est composée d'un étage de puissance reconfigurable constitué de deux cellules de puissance de type LDMOS pouvant être activées ou non en fonction du mode adressé. Différents réseaux d'adaptation accordables à base de capacités commutées utilisant des transistors NMOS à body flottant permettent une optimisation des performances du MMPA en fonction du mode et de la bande de fréquence. Avec ce prototype, des puissances de sortie de 35dBm en mode saturé et 30dBm en mode linéaire ont été mesurées avec des rendements correspondants supérieurs respectivement à 58% et 47%. Par rapport aux simulations initiales, des différences ont été observées puis analysées afin d'en identifier l'origine. Notamment, la surestimation du facteur de qualité des capacités MOM dans les réseaux de capacités commutées et des interconnections sous optimales sont la cause des écarts observés.Le deuxième prototype est un amplificateur de puissance à modulation de charge passive intégrée. Cet amplificateur repose sur une cellule de puissance de type LDMOS associée à un réseau d'adaptation accordable à base de capacités commutées capables de supporter une puissance supérieure à 33dBm. Ce réseau permet de présenter à l'étage de puissance une trajectoire de charge optimale en fonction de la puissance de sortie. Avec ce prototype, une amélioration du rendement supérieure à 55% par rapport à la configuration utilisant une charge constante a été mesurée pour un recul en puissance compris entre 7dB et 11dB. / This work focuses on the study and integration of a reconfigurable multi-mode multi-band power amplifier (MMPA) supporting 2G/3G/4G at several frequency bands in SOI CMOS 130nm technology. Current hybrid MMPA modules take advantage of multiple technologies, in particular GaAs for power devices. This adds to the cost and complexity of radiofrequency front-end modules. The original solution presented in this thesis is a significant step toward the integration of MMPA compared to the state of the art and initial results illustrates the relevance of the proposed architecture. A study on PA efficiency under 3G / 4G modulated signals is also presented by comparing load and supply modulation PA architectures.First, the context and state of the art are presented. A design methodology based on the study of different operating classes is then presented, which allows pre-sizing of power cells and optimal load impedance determination for high efficiency reconfigurable PA design.The proposed PA design methodology led to the implementation of PA demonstrators integrated in SOI CMOS 130nm technology. The first demonstrator is a two stage reconfigurable MMPA operating from 700MHz to 900MHz and supporting saturated and linear modes. The power stage comprises two SOI LDMOS power cells that are activated according to the desired mode. Tunable matching networks based on switched capacitor arrays allow optimization of the MMPA performance according to the mode and band. The measured prototype delivers up to 35dBm of output power in saturated mode with more than 58% efficiency. In linear mode, the measured output power exceeds 30dBm with efficiency higher than 47%. Compared to initial simulations, some differences were observed. In particular, underestimation of losses associated with MOM capacitors and sub-optimal interconnections are the root cause of the observed discrepancies.The second demonstrator is a passive load modulation PA architecture. It includes a SOI LDMOS power cell and a tunable matching network made of high power binary weighted switched capacitor arrays. The tunable matching network allows presenting an optimal load trajectory to the PA in order to maximize its back-off efficiency. Measured efficiency enhancement is higher than 55% compared to a fixed load configuration for 7dB to 11dB power back-offs.

Ce travail porte sur l'étude d'un oscillateur de puissance contrôlé en tension en ondes millimétriques. L'objectif de la thèse est de concevoir cet oscillateur pour la bande de fréquence utilisée dans les standards IEEE 802.15.3c, IEEE 802.11ad et ECMA TC48, à savoir 56GHz-65GHz. Le principe de l'oscillateur de puissance est développé autour d'un amplificateur de puissance rebouclé pour engendrer un système oscillant. L'amplificateur de puissance développé est un amplicateur à deux étages. Celui de puissance est de classe E et le driver est de classe F. La boucle de retour est basée sur un vecteur-modulateur. Les circuits ont été fabriqués en technologie CMOS 65nm de STMicroelectronics. / This PhD thesis deals with a Power Voltage Controlled Oscillator (VCO) in millimeter waves. The aim is to design this Power VCO in the frequency band used in the standards IEEE 802.15.3c, IEEE 802.11ad and ECMA TC48, meaning from 56GHz to 65GHz. The principle of this oscillator is developed around a power amplifier in a loop, generating an oscillating system. The power amplifier is developed in a two-stage topology. The power stage is composed with a 60GHz class E cascoded amplifier and the driver stage is composed of a 60GHz class F amplifier. The feedback of the loop is based on a vector-modulator. The circuits have been realised in 65nm CMOS technology from STMicroelectronics.

Les systèmes de transmission de l’information sans fil connaissent un essor considérable et sont intégrés dans la plupart des systèmes électroniques modernes. De manière plus spécifique, la consommation énergétique de la fonction amplification de puissance RF, qui constitue le cœur de ce travail de recherche, est un enjeu économique et écologique de premier plan. Dans ce sens, ce travail présente une architecture de polarisation de drain dynamique permettant de maintenir un rendement énergétique élevé sur une large dynamique de puissance de sortie. La conception et la réalisation d’un amplificateur de puissance RF large bande, d’un modulateur de polarisation de drain haute fréquence et d’un pilote de grille en technologie GaN sont présentés. L’architecture proposée démontre une amélioration du rendement énergétique global. Une focalisation sur la problématique de couplage non-linéaire entre l’amplificateur de puissance RF et le module d’alimentation agile met en évidence les répercussions de cette méthode sur l’intégrité du signal. Une étroite impulsion de polarisation de grille est appliquée afin d'atténuer l’impact de la polarisation dynamique de drain sur les formes d'onde de l'enveloppe du signal RF amplifié. Une validation expérimentale du démonstrateur proposée est effectuée pour un signal impulsionnel RF multi-niveaux de test. Cette méthode permet de maintenir un facteur de forme de l’enveloppe du signal de sortie RF quasi-rectangulaire sans impact majeur sur les performances globales énergétiques. / Wireless communications are experiencing tremendous growth and are integrated into most modern electronic systems. More precisely, saving energy consumption of RF power amplifier is the core of this thesis work. This work presents a dynamic drain bias architecture used to keep a high efficiency over a large output power range. Design and implementation of a wideband RF power amplifier, a drain supply modulator and a gate driver circuit in GaN technology are presented. The built-in prototype demonstrates an overall efficiency improvement. A specific focus on non-linear interaction between the RF power amplifier and the drain supply modulator highlights the effects of this technique on the output envelope signal shape. A narrow pulse gate bias peaking preceding drain bias voltage variations is applied in order to mitigate drain bias current, voltage overshoot and power droop, thus improving pulse envelope waveforms of the RF output signal. An experimental validation of the proposed demonstrator is performed for a RF pulsed test sequence having different power levels. This way enables to keep rectangular pulse envelope shape at the RF output signal without any major impact on overall efficiency performances.

L'augmentation des performances des futurs systèmes dynamiques nécessite la prise en compte des phénomènes physiques non linéaires. Cette thèse apporte un éclairage et des contributions sur deux sujets complémentaires liés aux phénomènes dynamiques non linéaires. Le mémoire de thèse est divisé en deux parties.La première partie porte sur les non-linéarités des amplificateurs de puissance dans le cadre d'applications destinées aux télécommunications ou à la diffusion audio-visuelle. Plusieurs méthodes de modélisation et de linéarisation des amplificateurs de puissance ont été conçues et discutées. Un banc de test a été développé afin d'évaluer les méthodes sur des amplificateurs réels. La robustesse de ces techniques à un mauvais alignement temporel des signaux ainsi que leur capacité à faire face à des artefacts spectraux ont été évaluées. Par ailleurs, nous avons effectué une étude théorique sur l'existence et la prise en compte de solutions multiples dans l'approche adaptative par apprentissage indirect. La deuxième partie traite des systèmes dynamiques non linéaires qui présentent des solutions chaotiques. Ces systèmes sont bien connus, mais les techniques d'identification de ces solutions manquent de fiabilité ou nécessitent une puissance de calcul importante. Dans cette thèse, plusieurs méthodes utilisant également le calcul parallèle sont présentées. Les systèmes à commande différentielle fractionnaire sont brièvement discutés. Il est aussi montré, qu'il existe des systèmes liés à des fonctions de transfert non linéaires avec quantification pour lesquels les méthodes d'analyse classiques échouent / In order to achieve better performance of modern communication devices, that have to be operated on its physical limits, the nonlinear phenomena need to be taken into the account. This thesis brings insight into two different subjects related with nonlinear dynamical phenomena. The thesis itself is divided into two parts : the first part is focused on the domain of nonlinear power amplifiers from the system point of view. Several methods for modelization and linearization of power amplifiers have been designed and discussed. A test-bench has been assembled in order to evaluate the proposed methods on real power amplifiers. Then the robustness to time misalignment in the system and the ability to deal with spectral artifacts in the system of presented methods have been evaluated. Also a theoretical study has been conducted on the existence and management of multiple solutions in the frame of adaptive indirect learning approach. The second part deals with nonlinear dynamical systems that are exhibiting chaotic solutions. Such systems are well known, but techniques for identifying reliable such solutions are either missing or are computational intense. In this thesis several methods using also parallel computing are presented. Systems with fractional differential order are briefly discussed. It is as well shown, that there exists systems related with quantified nonlinear transfer functions for which the standard analyzing methods fails

Avec la prolifération des appareils électroniques portables et mobiles communicants, il est recommandé de pouvoir échanger des données rapidement et commodément entre les appareils. Avec la pénurie de bande passante et la congestion dans le spectre des fréquences faibles, la technologie de communication à ondes millimétriques (Mm-wave) est considérée comme l'une des technologies clés du futur pour permettre des applications sans fil à débit élevé grâce à son large spectre abondant. Les nœuds de technologie CMOS avancés sont dotés de ft et fmax plus élevés qui permettent une utilisation peu coûteuse et généralisée de ce spectre. Cependant, de nombreux défis associés à la conception de circuits et de systèmes RF millimétriques en utilisant des technologies CMOS avancées ont été identifiés. L’amplificateur de puissance (PA) a été identifié comme étant le bloc le plus difficile à concevoir dans un émetteur-récepteur intégré RF millimétrique. Le concept au niveau du système de l’architecture basse puissance est d’abord étudié et des blocs clés tels que l’antenne 60 GHz et le modulateur OOK dans la technologie CMOS 130nm ont été présentés. Cette thèse explore également les défis de conception de l’amplificateur de puissance à ondes millimétriques dans la technolgie 28nm UTBB-FDSOI. Trois conceptions différentes d’amplificateur de puissance de 60 GHz ont été démontrées dans 28nm LVT FDSOI : 1) Un PA cascode à deux étages, 2) Un PA différentiel à deux étages à base de transformateur, 3) Un PA différentiel à deux étages à puissance combinée. Les performances simulées, y compris la prise en compte des parasites principaux de disposition ont été présentées. Les travaux futurs incluront l’intégration sur puce avec le PA. / With the proliferation of portable and mobile electronic devices, there is a strong need to exchange data quickly and conveniently between devices encouraging to overcome challenges in bandwidth shortages and congestion in the lower frequencies spectrum. Millimeter-wave (Mm-wave) technology is considered as one of the future key technologies to enable high data rates wireless applications due to its large abundant spectrum. Advanced CMOS technology nodes comes with high ft and fmax, enable low cost and widespread use of this spectrum. However, many associated challenges ranging from device, circuit and system perspectives for the implementation of a highly integrated mm-wave transceiver especially the power amplifier (PA) which identified to be the most challenging RF block to be designed. The system level concept of low power architecture is firstly studied and key blocks such as 60 GHz antenna and OOK modulateur in 130nm CMOS technology were presented. This thesis also explores the design challenges of mm-wave power amplifier in 28nm UTBB-FDSOI technology. Three different designs of 60 GHz power amplifier were demonstrated in 28nm LVT FDSOI : 1) A two-stage cascode PA, 2) A two-stage differential PA with low-km TMN, 3) A power combined two-stage differential PA with low-km TMN. The simulated performance including the consideration of key layout parasitics were presented. Future work will include for on-chip integration with the PA.

Ce travail répond à un besoin industriel accru en termes d’amplification des signaux sur porteuses à enveloppes variables utilisés par les systèmes de télécommunications actuels. Ces signaux disposent d’un fort PAPR et d’une distribution statistique d’enveloppe centrée en-deçà de la valeur crête d’enveloppe. La raison pour laquelle les industriels télécoms requièrent alors des amplificateurs de très fortes puissances de sortie, robustes, fiables et ayant une dépense énergétique optimale le long de la dynamique d’enveloppe associée à un niveau de linéarité acceptable. Ce document expose les résultats d’étude et de réalisation de deux Amplificateurs de Puissance Doherty (APD) à haut rendement encapsulés en boîtiers plastiques QFN. Le premier est un amplificateur Doherty symétrique classique (APD-SE) et le second est un amplificateur à deux entrées RF (APD-DE). Ces démonstrateurs fonctionnant en bande C sont fondés sur l’utilisation de la technologie Quasi-MMIC associant des barrettes de puissance à base des transistors HEMTs AlGaN/GaN sur SiC à des circuits d’adaptation en technologie ULRC. L’approche Quasi-MMIC associée à la solution d’encapsulation plastique QFN permettant une meilleure gestion des comportements thermiques offre des performances électriques similaires à celles de la technologie MMIC avec des coûts et des cycles de fabrication très attractifs. Durant ces travaux, une nouvelle méthode d’évaluation des transistors dédiés à la conception d’amplificateurs Doherty a été développée et mise en oeuvre. L’utilisation intensive des simulations électromagnétiques 2.5D et 3D a permis de bien prendre en compte les effets de couplages entre les différents circuits dans l’environnement du boîtier QFN. Les résultats des tests des amplificateurs réalisés fonctionnant sur une bande de 1GHz ont permis de valider la méthode de conception et ont montré que les concepts avancés associés à l’approche Quasi-MMIC ainsi qu’à des technologies d’encapsulation plastique, peuvent générer des fonctions micro-ondes innovantes. Les caractérisations de l’APD-DE ont relevé l’intérêt inhérent à la préformation des signaux d’excitation et des points de polarisation de chaque étage de l’amplificateur. / This work responds to an increased industrial need for on carrier signals with variable envelope amplification used by current telecommunications systems. These signals have a strong PAPR and an envelope statistical distribution centred below the envelope peak value, the reason why the telecom industrialists then require a robust and reliable high power amplifiers having an energy expenditure along of the envelope dynamics associated with an acceptable level of linearity. This document presents the results of the study and realization of two, high efficiency, Doherty Power Amplifiers (DPA) encapsulated in QFN plastic packages. The first is a conventional Doherty power Amplifier (DPA-SE) and the second is a dual-input Doherty power amplifier (DPA-DE). These C-band demonstrators are based on the use of Quasi-MMIC technology combining power bars based on the AlGaN/GaN transistors on SiC to matching circuits in ULRC technology. The Quasi-MMIC approach combined with Quasi-MMIC approach combined with QFN plastic package solution for better thermal behaviour management offers electrical performances similar to those of MMIC technology with very attractive coasts and manufacturing cycles. During this work, a new evaluation method for the transistors dedicated to the design of DPA was developed and implemented. The intensive use of 2.5D and 3D electromagnetic simulations made it possible to take into account the coupling effects existing between the different circuits in the QFN package environment. The results of the tests of the amplifiers realised and operating on 1GHz bandwidth validated the design method and showed that the advanced concepts associated with the Quasi-MMIC approach as well as plastic encapsulation technologies can generate innovative microwave functions. The characterizations of the DPA-DE have noted the interest inherent in the preformation of the excitation signals and the bias points of each stage of the amplifier.