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This work focuses on the evaluation of the feasibility to employ silicon (Si) nanowire based parallel arrays of Schottky-barrier field effect transistors (SB-FETs) as transducers for potentiometric biosensors and their overall performance as building blocks for novel functional electronics. Nanowire parallel arrays of SB-FETs were produced and electrically characterized during this work. Nominally undoped Si nanowires with mean diameter of 20nm were synthesized by chemical vapor deposition (CVD) driven bottom-up growth and subsequently transferred via a printing process to Si/SiO2 chip substrates. Thereby, dense parallel aligned nanowire arrays are created. After dry oxidation of the nanowires, standard photolithography and deposition methods are employed to contact several hundred nanowires with interdigitated Ni electrodes in parallel. A silicidation step is used to produce axially intruded Ni-silicide (metallic) phases with a very abrupt interface to the Si (semiconducting) segment. Acting as front gate dielectric, the chip surface is entirely covered by an Al2O3 layer. For sensor applications, this layer further serves as electrical isolation of the electrodes and protects them from corrosion in electrolytes. Fabricated devices are part of the SOI (Si on insulator) transistor family with top (front) and back gate and exhibit ambipolar rectifying behavior. The top gate exhibits omega geometry with a 20nm thin Al2O3 dielectric, the back gate planar geometry with a 400nm thick SiO2 dielectric. The influence of both gates on the charge transport is summarized in the statistical analysis of transfer and output characteristic for 7 different lengths (for each 20 devices) of the Si conduction channel. A nonlinear scaling of on-currents and transconductance with channel length is revealed. Off-currents are influenced from both p- and n-type conduction at the same time. Increasing lateral electric fields (LEF) lead to a decline of suppression capability of both p- and n-currents by a single gate. This is reflected in a deteriorated swing and higher off-current towards decreasing channel lengths (increasing LEF). However, by individual gating of Schottky junction and channel, p- and n-type currents can be controlled individually. Both charge carrier types, p and n, can be suppressed efficiently at the same time leading to low off-currents and high on/off current ratio for all investigated channel lengths. This is achieved by a combined top and back double gate architecture, for which the back gate controls the Schottky junction resistance. It is demonstrated that a fixed high Schottky junction serial resistance, severely impairs the transconductance. However, the transconductance can be significantly increased by lowering this resistance via the back gate, enhancing the transducer performance significantly. Al2O3 covered SB-FETs were employed as pH sensors to evaluate their performance and signal to noise ratio (SNR). Current modulation per pH was observed to be directly proportional to the transconductance. The transistor related signal to noise ratio (SNR) is thus proportional to the transconductance to current noise ratio. Device noise was characterized and found to limit the SNR already below the peak transconductance regime. Statistical analysis showed that the nanowire SB-FET transconductance and noise both scale proportional with the current. Therefore, the SNR was found to be independent on the nanowire channel lengths under investigation. The high process yield of nanowire SB-FET parallel array fabrication close to hundred percent enables this platform to be used for simple logic and biosensor elements. Because of the low fabrication temperatures needed, the foundation is laid to produce complementary logic with undoped Si on flexible substrates. For previously reported results, the presence of Schottky junctions severely impaired the transconductance, restricting the applicability of SB-FETs as transducers. This work shows, that an electric decoupling of the Schottky junction can reduce these restrictions, making SB-FETs feasible for sensor applications.:Table of contents 11 List of figures 14 Abbreviations 15 Introduction 17 1 Fundamentals 23 1.1 Bottom up growth of Si nanowires 23 1.2 MOS and Schottky barrier transistor theory 25 1.2.1 MOSFET: Metal Oxide Semiconductor Field Effect Transistor 25 1.2.2 Gate coupling 27 1.2.3 Oxide charges and flatband voltage 29 1.2.4 Charge trapping and charge-voltage hysteresis 30 1.2.5 Schottky barrier 32 1.2.6 SB-FETs 34 1.3 ISFET and BioFET technology 36 1.3.1 ISFET and BioFET working principle 37 1.3.2 Noise in ISFETs 41 2 Fabrication of Schottky barrier FET parallel arrays 43 2.1 Starting point of device fabrication 43 2.2 Parallel array transistor and sensor devices 44 2.2.1 Gold nano particle deposition 45 2.2.2 Bottom-up growth of Si nanowires 46 2.2.3 Nanowire deposition methods 48 Langmuir-Blodgett 48 Adhesion tape transfer 49 Contact printing/ smearing transfer 49 2.2.4 Nanowire oxidation 50 2.2.5 Chip design 51 2.2.6 UV lithography 53 2.2.7 Oxide removal and metal deposition 54 2.2.8 Nanowire silicidation 54 2.2.9 Ionsensitive, top gate dielectric and contact passivation 56 2.2.10 On chip reference electrode 57 3 Electrical characterization 59 3.1 Electrical characterization methods 59 3.2 Transfer characteristics 60 3.2.1 Silicidation: intruded silicide contacts 62 3.2.2 Scaling of the conduction channel length 63 3.2.3 Flatband voltage, built-in potentials, fixed and trapped oxide charge 71 3.2.4 Surface effects on the channel potential of back gated SB-FETs 72 3.3 Charge traps, hysteresis and Vth drifts 73 3.3.1 Screening of back gate fields by water molecules 74 3.3.2 Native oxides: unipolarity by water promoted charge trapping 76 3.3.3 Hysteresis for thermally grown oxide back and top gate devices 78 3.3.4 Hysteresis reduction by post anneal 79 3.4 Output characteristics 80 3.4.1 Unipolar output characteristics of nanowires with native oxide shell 80 3.4.2 Ambipolar output characteristics of nanowires with dry oxidized shell 82 3.5 Temperature dependence 84 3.6 Transistor noise 86 4 pH measurements 91 4.1 Experimental setup and data analysis method 91 4.2 Transfer function in electrolyte with liquid gate 92 4.3 Sensor response on pH 92 4.4 Sensor signal drifts 96 5 Schottky junction impact on sensitivity 97 5.1 Schottky junction electrostatic decoupling in solution 97 5.1.1 Experimental setup in solution 98 5.1.2 SU8/Al2O3 passivated junctions in electrolyte 98 5.2 Meander shaped gates without Schottky junction overlap 101 5.2.1 Separated gating of Schottky junctions and channel 102 5.2.2 Enhanced transducer performance by reduced Schottky junction resistance 104 6 Summary and Outlook 107 List of publications 111 Bibliography 126 Acknowledgements 127 / Diese Dissertation ist der Bewertung von Silizium (Si) Nanodraht basierten Parallelschaltungen von Schottky-Barrieren-Feld-Effekt-Transistoren (SB-FETs) als Wandler für potentiometrische Biosensoren und deren generelle Leistungsfähigkeit als Bauelement neuartiger funktioneller Elektronik gewidmet. In dieser Arbeit wurden Parallelschaltungen von Nanodraht SB-FETs hergestellt und elektrisch charakterisiert. Nominell undotierte Si Nanodrähte mit durchschnittlichem Durchmesser von 20nm wurden mittels chemischer Dampfphasenabscheidung (CVD) synthetisiert und anschließend durch einen Druckprozess auf ein Si/SiO2 Chip-Substrat transferiert. Damit wurden dicht gepackte, parallel ausgerichtete Nanodraht Schichten erzeugt. Nach Trockenoxidation der Nanodrähte wurden diese mit Standard Lithographie und Abscheidungsmethoden mit interdigitalen Nickel (Ni) Elektroden als Parallelschaltung kontaktiert. Durch einen Temperprozess bilden sich axial eindiffundierte metallische Ni-Silizid-Phasen, mit einer sehr abrupten Grenzfläche zum halbleitenden Si Segments des Nanodrahts. Die Chipoberfläche wird vollständig mit einer Al2O3-Schicht bedeckt, welche als Frontgate-Dielektrikum oder als elektrische Isolation und Korrosionsschutzschicht für Elektroden in Elektrolytlösungen im Falle der Sensoranwendungen dient. Die hier gezeigten Bauelemente sind Teil der SOI (Si on insulator) Transistoren-Familie mit Top- (Front) und Backgate und zeigen ein ambipolares Schaltverhalten. Die Topgates besitzen eine Omega-Geometrie mit 20nm dickem Al2O3 Dielektrikum, das Backgate eine planare Geometrie mit 400nm dickem SiO2 Dielektrikum. Der Einfluss beider Gates auf den Ladungstransport ist in einer statistischen Analyse der Transfer- und Output-Charaktersitiken für 7 unterschiedliche Si-Leitungskanallängen zusammengefasst. Eine nichtlineare Skalierung von Strom und Transkonduktanz mit Leitungskanallänge wurde aufgedeckt. Die Ströme im Aus-Zustand des Transistors sind durch das Vorhandensein gleichzeitiger p- als auch n-Typ Leitung bestimmt. Die Zunahme lateraler elektrischer Felder (LEF) führt zu einem Verlust des gleichzeitigen Ausschaltvermögens von p- und n-Strömen bei Ansteuerung mit einem einzelnen Gate. Dies äußert sich durch einen graduell verschlechterten Swing und höheren Strom im Aus-Zustand bei verringerter Leitungskanallänge (gleichbedeutend mit erhöhten LEF). Durch eine getrennte Ansteuerung von Schottky-Kontakt und Leitungskanal lassen sich p- and n-Leitung jedoch unabhängig voneinander kontrollieren. Beide Ladungsträgertypen können so simultan effizient unterdrückt werden, was zu einem geringen Strom im Aus-Zustand und einem hohen An/Aus- Stromverhältnis für alle untersuchten Kanallängen führt. Dies wird durch eine Gatearchitektur mit kombiniertem Top- und Backgate erreicht, bei der das Backgate den Ladungstransport durch den Schottky-Kontakt und dessen Serienwiderstand kontrolliert. Es wird gezeigt, dass ein konstant hoher Schottky-Kontakt bedingter Serienwiderstand die Transkonduktanz erheblich vermindert. Jedoch kann die Transkonduktanz im höchsten Maße durch eine Herabsetzung des Serienwiderstandes durch das Backgate gesteigert werden. Dies erhöht die Leistungsfähigkeit des SB-FET als Wandler deutlich. Al2O3 oberflächenbeschichtete SB-FETs wurden als pH-Sensoren erprobt, um deren Tauglichkeit und Signal-zu-Rausch-Verhältnis (SNR) zu evaluieren. Die Strommodulation pro pH-Wert konnte als direkt proportional zur Transkonduktanz bestätigt werden. Das Transistor bedingte SNR ist daher proportional zum Verhältnis von Transkonduktanz und Stromrauschen. Bei der Analyse des Transistorrauschens wurde festgestellt, dass dieses das SNR bereits bei einer niedrigeren Transkonduktanz als der maximal Möglichen limitiert. Eine statistische Auswertung zeigte, dass sowohl SB-FET Transkonduktanz als auch Stromrauschen proportional zu dem Transistorstrom skalieren. Somit ist deren Verhältnis unabhängig von der Nanodraht-Leitungskanallänge, im hier untersuchten Rahmen. Die geringe Ausschuss bei der Fabrikation der Nanodraht SB-FET-Parallelschaltungen ermöglicht eine Nutzung dieser Plattform für simple Logik und Biosensorelemente. Durch die geringen Prozesstemperaturen wurde die Grundlage geschaffen, komplementäre Logik mit undotiertem Si auf flexiblen Substraten zu fertigen. Vorangegangene Resultate zeigte eine verminderte Transkonduktanz durch die Präsenz von Schottky-Barrieren, was die Anwendbarkeit von SB-FETs als Wandler einschränkt. Diese Arbeit zeigt, dass eine elekrtische Entkopplung der Schottky-Kontakte zu einer Aufhebung dieser Beschränkung führen kann und somit den Einsatz von SB-FETs als praktikable Wandler für Sensoranwendungen zulässt.:Table of contents 11 List of figures 14 Abbreviations 15 Introduction 17 1 Fundamentals 23 1.1 Bottom up growth of Si nanowires 23 1.2 MOS and Schottky barrier transistor theory 25 1.2.1 MOSFET: Metal Oxide Semiconductor Field Effect Transistor 25 1.2.2 Gate coupling 27 1.2.3 Oxide charges and flatband voltage 29 1.2.4 Charge trapping and charge-voltage hysteresis 30 1.2.5 Schottky barrier 32 1.2.6 SB-FETs 34 1.3 ISFET and BioFET technology 36 1.3.1 ISFET and BioFET working principle 37 1.3.2 Noise in ISFETs 41 2 Fabrication of Schottky barrier FET parallel arrays 43 2.1 Starting point of device fabrication 43 2.2 Parallel array transistor and sensor devices 44 2.2.1 Gold nano particle deposition 45 2.2.2 Bottom-up growth of Si nanowires 46 2.2.3 Nanowire deposition methods 48 Langmuir-Blodgett 48 Adhesion tape transfer 49 Contact printing/ smearing transfer 49 2.2.4 Nanowire oxidation 50 2.2.5 Chip design 51 2.2.6 UV lithography 53 2.2.7 Oxide removal and metal deposition 54 2.2.8 Nanowire silicidation 54 2.2.9 Ionsensitive, top gate dielectric and contact passivation 56 2.2.10 On chip reference electrode 57 3 Electrical characterization 59 3.1 Electrical characterization methods 59 3.2 Transfer characteristics 60 3.2.1 Silicidation: intruded silicide contacts 62 3.2.2 Scaling of the conduction channel length 63 3.2.3 Flatband voltage, built-in potentials, fixed and trapped oxide charge 71 3.2.4 Surface effects on the channel potential of back gated SB-FETs 72 3.3 Charge traps, hysteresis and Vth drifts 73 3.3.1 Screening of back gate fields by water molecules 74 3.3.2 Native oxides: unipolarity by water promoted charge trapping 76 3.3.3 Hysteresis for thermally grown oxide back and top gate devices 78 3.3.4 Hysteresis reduction by post anneal 79 3.4 Output characteristics 80 3.4.1 Unipolar output characteristics of nanowires with native oxide shell 80 3.4.2 Ambipolar output characteristics of nanowires with dry oxidized shell 82 3.5 Temperature dependence 84 3.6 Transistor noise 86 4 pH measurements 91 4.1 Experimental setup and data analysis method 91 4.2 Transfer function in electrolyte with liquid gate 92 4.3 Sensor response on pH 92 4.4 Sensor signal drifts 96 5 Schottky junction impact on sensitivity 97 5.1 Schottky junction electrostatic decoupling in solution 97 5.1.1 Experimental setup in solution 98 5.1.2 SU8/Al2O3 passivated junctions in electrolyte 98 5.2 Meander shaped gates without Schottky junction overlap 101 5.2.1 Separated gating of Schottky junctions and channel 102 5.2.2 Enhanced transducer performance by reduced Schottky junction resistance 104 6 Summary and Outlook 107 List of publications 111 Bibliography 126 Acknowledgements 127

In dieser Arbeit werden organische Feldeffekttransistoren (OFETs) aus den verschiedenen Materialien Manganphthalocyanin (MnPc), [6,6]Phenyl-C61-butansäuremethylester (PCBM), 6,13-Bis(triisopropylsilyethinyl)pentacen (TIPS-Pentacen) und N,N’- Bis(n-octyl)-1,6-Dicyanoperylen-3,4:9,10-Bis(Dicarboximid) (PDI8-CN2) hergestellt. Dabei finden unterschiedliche Abscheidemethoden wie die Molekularstrahlabscheidung, die Ultraschallsprühbeschichtung und die Drehbeschichtung Anwendung. Die Morphologie sowie die Funktionsweise der Transistoren werden in Abhängigkeit von den Herstellungsparametern und bezüglich ihrer Stabilität gegenüber Lufteinfluss und elektrischer Belastung charakterisiert. Durch Aufdampfen von MnPc konnten so zum ersten Mal ambipolare MnPc-OFETs hergestellt und charakterisiert werden. Die bestimmten Löcher- und Elektronenbeweglichkeiten bestätigen die Eignung von MnPc für die Anwendung in Spintronik-Bauelementen. Desweiteren wird anhand gesprühter PCBM- und TIPS-Pentacen-OFETs gezeigt, dass die Ultraschallsprühbeschichtung eine geeignete Technik ist, um organische Halbleiter aus Lösung für die Verwendung in OFETs abzuscheiden. Die Abscheidung organischer Filme lässt sich mit einer Vielzahl an Parametern beeinflussen und die Funktionsweise von OFETs optimieren. In Verbindung mit den Untersuchungen aufgeschleuderter PDI8-CN2-OFETs konnte ein erheblicher Einfluss der Oberflächenenergie des verwendeten SiO2-Gateisolators auf die Korngröße im organischen Film festgestellt werden.

Afin de pouvoir continuer la miniaturisation de la brique de base des circuits électroniques, le transistor MOS, l’introduction d’oxyde de grille à haute permittivité était inévitable. Un empilement de type high-k/grille métal en remplacement du couple SiO2 /Poly-Si est introduit afin de limiter le courant de fuite tout en conservant un bon contrôle électrostatique du canal de conduction. L’introduction de ces matériaux pose naturellement des questions de fiabilité des dispositifs obtenus et ce travail s’inscrit dans ce contexte. Afin de réaliser des mesures de durée de vie sans avoir à finir les dispositifs, une méthode utilisant le C-AFM sous ultravide est proposée. Le protocole expérimental repose sur une comparaison systématique des distributions des temps de claquage obtenues à l’échelle du composant et à l’échelle nanométrique. La comparaison systématique des mesures s’avère fiable si l’on considère une surface de contact entre la pointe et le diélectrique de l’ordre du nm². Des distributions de Weibull présentant une même pente et un même facteur d’accélération en tension sont rapportées montrant une origine commune pour le mécanisme de rupture aux deux échelles.Une résistance différentielle négative, précédant la rupture diélectrique, est rapportée lors de mesures courant–tension pour certaines conditions de rampe. Ce phénomène de dégradation de l’oxyde, visible grâce au C-AFM , est expliqué et modélisé dans ce manuscrit par la croissance d’un filament conducteur dans l’oxyde. Ce même modèle permet aussi de décrire la rupture diélectrique.Finalement, l’empilement de grille bicouche du noeud 28nm est étudié. Une preuve expérimentale montrant que la distribution du temps de claquage du bicouche est bien une fonction des caractéristiques de tenue en tension propres de chaque couche est présentée. / In order to continue the scaling of the MOS transistor the replacement of the gate oxide layer by a high K/Metal gate was mandatory. From a reliability point of view, the introduction of these new materials could cause a lifetime reduction. To test the lifetime of the device a new technique using the C-AFM under Ultra High Vacuum is proposed. The experimental approach is based on a systematic comparison between the time to failure distribution obtained at device scale and at nanoscale. The comparison is reliable if we assume a contact surface of several nm² under the tip. Weibull distributions with a same slope and a same voltage acceleration factor have been found exhibiting a common origin of breakdown at both scales.We have reported a negative differential resistance phenomenon during Current-Voltage measurements. This degradation phenomenon has been modelled and explained by the growth of a conductive filament in the oxide layer. This model is also able to describe the breakdown of the oxide layer.Finally the bi layer gate stack of the 28nm node was studied. The first experimental proof confirming that the lifetime distribution of the bi-layer gate stack is a function of the lifetime of each layer taken separately is presented.

Ces dix dernières années, les technologies de stockage non-volatile Flash ont joué un rôle majeur dans le développement des appareils électroniques mobiles et multimedia (MP3, Smartphone, clés USB, ordinateurs ultraportables…). Afin d’améliorer davantage les performances, augmenter les capacités et diminuer les coûts de fabrication, de nouvelles solutions technologiques sont aujourd’hui étudiées pour pouvoir compléter ou remplacer la technologie Flash. Citées par l’ITRS, les mémoires résistives polymères présentent des caractéristiques très prometteuses : procédés de fabrication à faible coût et possibilité d’intégration haute densité au dessus des niveaux d’interconnexions CMOS ou sur substrat souple. Ce travail de thèse a été consacré au développement et à l'étude des mémoires résistifs organiques à base de polymère de poly-méthyl-méthacrylate (PMMA) et de molécules de fullerènes (C60). Trois axes de recherche ont été menés en parallèle: le développement et la caractérisation physico-chimique de matériaux composites, l’intégration du matériau organique dans des structures de test spécifiques et la caractérisation détaillée du fonctionnement électrique des dispositifs et des performances mémoires. / Over the past decade, non-volatile Flash storage technologies have played a major role in the development of mobile electronics and multimedia (MP3, Smartphone, USB, ultraportable computers ...). To further enhance performances, increase the capacity and reduce manufacturing costs, new technological solutions are now studied to provide complementary solutions or replace Flash technology. Cited by ITRS, the polymer resistive memories present very promising characteristics: low cost processing and ability for integration at high densities above CMOS interconnections or on flexible substrate. This PhD specifically focused on the development and study of composite material made of Poly-Methyl-Methacrylate (PMMA) polymer resist doped with C60 fullerene molecules. Studies were carried out on three different axes in parallel: Composite materials development & characterization, integration of the organic material in specific test structure and advanced devices and finally detailed electrical characterization of memory cells and performances analysis.

L’électronique de puissance a un rôle de plus en plus grandissant dans les systèmes de transports : voitures électriques et hybrides, trains et avions. Pour ces applications, la sécurité est un point critique et par conséquent la fiabilité du système de puissance doit être optimisée. La connaissance du temps de fonctionnement avant défaillance est une donnée recherchée par les concepteurs de ces systèmes. Dans cette optique, un indicateur de défaillance précoce permettrait de prédire la défaillance des systèmes avant que celle-ci soit effective. Dans cette thèse, nous nous sommes intéressés à la caractérisation électromécanique des puces de puissance IGBT et MOSFET. L’exploitation de cette caractérisation devrait permettre, à plus long terme, de mettre en évidence un indicateur de l’état mécanique des assemblages de puissance à des fins de fiabilité prédictive. / Power electronics has a role increasingly growing up in transport:electric and hybrid vehicles, trains and aircraft. For these applications, security is a critical point, thus the reliability of the power assembly must be optimized. The knowledge of time to failure is very important information for the designers of these systems. Inthis context, an early failure indicator would predict system failuresbefore it becomes effective. In this thesis, we focused on the electromechanical characterization of power transistors: MOSFET and IGBT. Based on these results this electromechanical characterization should help us in the longer term, to highlight an early failure indicator of the power assembly.

Ce travail de recherche porte sur l’étude de l’effet du vieillissement par fatigue électrothermique sur la compatibilité électromagnétique des composants de puissance à base de carbure de silicium. Il est axé sur deux grandes parties ; une partie expérimentale et une autre plus orientée modélisation. Sur le plan expérimental, cette thèse étudie l’effet du vieillissement des transistors à base de carbure de silicium utilisés dans les convertisseurs statiques sur les perturbations électromagnétiques générées par ces convertisseurs. La deuxième partie porte sur la modélisation de ces transistors afin d’émuler l’effet de leur vieillissement sur les perturbations électromagnétiques des modules qu’ils composent. Cette dernière étape repose sur une étude de l’évolution des caractéristiques électriques statiques et dynamiques effectuées sur le composant sous test pour extraire les principaux paramètres intrinsèques du transistor de puissance dégradé après les séries de stress appliquées. En effet, ces paramètres intrinsèques dégradés émulent l’effet du vieillissement et sont représentatifs des principaux phénomènes pouvant influencer les convertisseurs de puissance étudiés. De ce fait, le changement de leurs valeurs dans le modèle du dit composant, décrit en VHDL-AMS et implémenté sur le simulateur de type circuit ANSYS SIMLORER, nous permet d’obtenir un modèle d’un tel composant après vieillissement. Cette étape a permis de valider la méthodologie développée pour la simulation des perturbations électromagnétiques conduites d’un composant sain dans un premier temps et d’un composant vieilli dans un second. Globalement, cette approche de modélisation innovante développée dans ce travail permet d’aider les concepteurs des convertisseurs statiques à prédire les perturbations électromagnétiques conduites avant et après vieillissement sans passer par la mesure et ses points faibles. Ceci apporte des informations complémentaires sur l’évolution des signatures CEM de tels modules durant sa durée de vie et d’estimer donc le risque lié au vieillissement des composants. / This research work focuses on the electrothermal aging effect on the electromagnetic compatibility of power components based on silicon carbide SiC. It focuses on two major parts ; an experimental part and another more oriented modelization. Experimentally, this thesis studies the aging effect of SiC transistors used in static converters on the electromagnetic interferences EMI generated by these converters. The second part deals with the modeling of these transistors in order to emulate the effect of their aging on the EMI of the modules they compose. This step made it possible to validate the methodology developed for the simulation of the conducted EMI of a healthy SiC MOFSET at first and of an aged SiC MOSFET in a second time. Overall, this innovative modeling approach developed in this work helps the designers of static converters to predict the conducted EMI before and after aging without going through the measurement. This provides additional information on the evolution of the EMC signatures of such modules during its lifetime and thus to estimate the risk associated with the aging of the components.

Un modèle de commutation de mémoires résistives (ReRAM) est présenté. Celui-ci est basé sur deux hypothèses : (1) la commutation résistive est causée par des changements qui se produisent dans la zone étroite (région active) du filament conducteur sous l'influence du champ électrique et (2) la commutation résistive est un processus stochastique, donc régi par une probabilité. La région active est représentée par un réseau de connexions verticales, chacune composée de trois éléments électriques : deux d'entre eux sont de faible résistance tandis que le troisième agit comme un disjoncteur et peut être soit de résistance faible (LR) ou élevée (HR). Dans ce modèle, le changement d'état du disjoncteur est régi par une probabilité de commutation (P$_{s}$) qui est comparée à un nombre aléatoire « p ». P$_{s}$ dépend de la chute de tension le long du disjoncteur et de la tension de seuil, V$_{set}$ ou V$_{reset}$, pour définir les processus de « set » (HR à LR) et « reset » (LR à HR). Deux mécanismes de conduction ont été envisagés : ohmique pour un état LR et pour un état de résistance élevée l'effet tunnel facilité par un piège (TAT). Le modèle a été implémenté avec le langage de programmation Python et fonctionne avec une bibliothèque C externe qui optimise les calculs et le temps de traitement. Les résultats de la simulation ont été validés avec succès en les comparant avec des courbes courant-tension (IV) mesurées sur dispositifs ReRAM réels dont l'oxyde était fait de HfO$_{2}$ et pour neuf aires différentes. La flexibilité et la facilité de mise en œuvre de ce modèle de commutation résistive en font un outil puissant pour l'étude des ReRAM / A model for the switching of resistive random-access memories (ReRAM) is presented. This model is based on two hypotheses: (1) the resistive switching is caused by changes that occur in the narrow zone (active region) of the conductive filament under the influence of the electric field and (2) the resistive switching is a stochastic process governed by a switching probability. The active region is represented by a net of vertical connections, each one composed of three electrical elements: two of them are always low resistive (LR) while the third one acts as a breaker and can be low or high resistive (HR). In the model, the change of the breaker's state is governed by a switching probability (P$_{s}$) that is compared with a random number $p$. P$_{s}$ depend on the voltage drop along the breaker and the threshold voltage, V$_{set}$ or V$_{reset}$ for set (HR to LR) or reset (LR to HR) processes. Two conduction mechanism has been proposed: ohmic for the low resistive state and trap-assisted tunneling (TAT) for the high resistive state. The model has been implemented in Python and works with an external C-library that optimizes calculations and processing time. The simulation results have been successfully validated by comparing measured and modeled IV curves of HfO$_{2}$-based ReRAM devices of nine different areas. It is important to note that the flexibility and easy implementation of this resistive switching model allow it to be a powerful tool for the design and study of ReRAM memories

In dieser Arbeit werden organische Feldeffekttransistoren (OFETs) aus den verschiedenen Materialien Manganphthalocyanin (MnPc), [6,6]Phenyl-C61-butansäuremethylester (PCBM), 6,13-Bis(triisopropylsilyethinyl)pentacen (TIPS-Pentacen) und N,N’- Bis(n-octyl)-1,6-Dicyanoperylen-3,4:9,10-Bis(Dicarboximid) (PDI8-CN2) hergestellt. Dabei finden unterschiedliche Abscheidemethoden wie die Molekularstrahlabscheidung, die Ultraschallsprühbeschichtung und die Drehbeschichtung Anwendung. Die Morphologie sowie die Funktionsweise der Transistoren werden in Abhängigkeit von den Herstellungsparametern und bezüglich ihrer Stabilität gegenüber Lufteinfluss und elektrischer Belastung charakterisiert. Durch Aufdampfen von MnPc konnten so zum ersten Mal ambipolare MnPc-OFETs hergestellt und charakterisiert werden. Die bestimmten Löcher- und Elektronenbeweglichkeiten bestätigen die Eignung von MnPc für die Anwendung in Spintronik-Bauelementen. Desweiteren wird anhand gesprühter PCBM- und TIPS-Pentacen-OFETs gezeigt, dass die Ultraschallsprühbeschichtung eine geeignete Technik ist, um organische Halbleiter aus Lösung für die Verwendung in OFETs abzuscheiden. Die Abscheidung organischer Filme lässt sich mit einer Vielzahl an Parametern beeinflussen und die Funktionsweise von OFETs optimieren. In Verbindung mit den Untersuchungen aufgeschleuderter PDI8-CN2-OFETs konnte ein erheblicher Einfluss der Oberflächenenergie des verwendeten SiO2-Gateisolators auf die Korngröße im organischen Film festgestellt werden.